ADC08D1500CIYB/NOPB 数字信号处理器销售
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商品详情
ADC08D1500CIYB/NOPB 数字信号处理器产品介绍
ADC08D1500CIYB/NOPB 询价热线ADC08D1500CIYB/NOPB 现货ADC08D1500CIYB/NOPB ADC08D1500是一款双通道，低功耗，高性能CMOS模数转换器，可在高达1.7 GSPS的采样速率下将信号数字化为8位分辨率。
产品名称：数字信号处理器
ADC08D1500CIYB/NOPB 特征
内部采样保持
单+ 1.9V±0.1V操作
可选择SDR或DDR输出时钟
交错模式，2倍采样率
多ADC同步能力
确保没有丢失的代码
扩展控制的串行接口
输入满量程范围和偏移的微调
占空比校正采样时钟
ADC08D1500CIYB/NOPB 产品详情
ADC08D1500是一款双通道，低功耗，高性能CMOS模数转换器，可在高达1.7 GSPS的采样速率下将信号数字化为8位分辨率。从单个1.9 V电源消耗1.5 GSPS的典型1.8瓦特，确保该器件在整个工作温度范围内无失码。独特的折叠和插值架构，全差分比较器设计，内部采样保持放大器的创新设计和自校准方案使得除Nyquist之外的所有动态参数的响应非常平坦，产生高7.25 ENOB和748 MHz输入信号和1.5 GHz采样率，同时提供10-18 CER输出格式为二进制，LVDS数字输出与IEEE 1596.3-1996兼容，但可调共模电压在0.8V和1.2V之间。
每个转换器都有一个1：2多路分解器，为两个LVDS总线供电，并将每条总线上的输出数据速率降低到采样率的一半。这两个转换器可以交错使用，并用作单个3 GSPS ADC。
该器件在掉电模式下的功耗通常低于3.5 mW，采用128引脚，耐热增强型裸露焊盘HLQFP，工作温度范围为-40°C≤TA≤+ 85°C。
基本SMJ320C2x架构的许多增强功能使C50的性能比上一代产品低2倍。一个四深度指令流水线，包括延迟分支，延迟调用子程序和延迟从子程序返回，允许C50以更少的周期执行指令。添加并行逻辑单元（PLU）为C50提供了一种在不使用累加器和ALU的情况下操作数据存储器中的位的方法。 C50具有额外的移位和缩放功能，可以将被乘数正确对齐或将值存储到数据存储器。
C50通过IDLE2指令实现低功耗。 IDLE2从C50的内部硬件中删除功能时钟，使其进入仅使用7 uA的完全睡眠模式。持续时间至少为5个时钟周期的外部中断的低逻辑电平将终止IDLE2模式。
C50有两种时钟速度。时钟频率为50 MHz，周期时间为40 ns，周期为66 MHz，周期时间为30 ns。表1列出了可用选项。
应用
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SMJ320C40HFHS60 5962-9466902QXC SMJ320C25GBM SMJ320C40HFHM50
SMJ320C40HFHM50 5962-9466902QXA 5962-9466902QXA SMJ320C40HFHS60
SMJ320C40HFHM40 5962-9679101QXA 5962-9466902QXC 5962-9679101QXA
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产品名称：数字信号处理器
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内部采样保持
单+ 1.9V±0.1V操作
可选择SDR或DDR输出时钟
交错模式，2倍采样率
多ADC同步能力
确保没有丢失的代码
扩展控制的串行接口
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ADC08D1500是一款双通道，低功耗，高性能CMOS模数转换器，可在高达1.7 GSPS的采样速率下将信号数字化为8位分辨率。从单个1.9 V电源消耗1.5 GSPS的典型1.8瓦特，确保该器件在整个工作温度范围内无失码。独特的折叠和插值架构，全差分比较器设计，内部采样保持放大器的创新设计和自校准方案使得除Nyquist之外的所有动态参数的响应非常平坦，产生高7.25 ENOB和748 MHz输入信号和1.5 GHz采样率，同时提供10-18 CER输出格式为二进制，LVDS数字输出与IEEE 1596.3-1996兼容，但可调共模电压在0.8V和1.2V之间。
每个转换器都有一个1：2多路分解器，为两个LVDS总线供电，并将每条总线上的输出数据速率降低到采样率的一半。这两个转换器可以交错使用，并用作单个3 GSPS ADC。
该器件在掉电模式下的功耗通常低于3.5 mW，采用128引脚，耐热增强型裸露焊盘HLQFP，工作温度范围为-40°C≤TA≤+ 85°C。
基本SMJ320C2x架构的许多增强功能使C50的性能比上一代产品低2倍。一个四深度指令流水线，包括延迟分支，延迟调用子程序和延迟从子程序返回，允许C50以更少的周期执行指令。添加并行逻辑单元（PLU）为C50提供了一种在不使用累加器和ALU的情况下操作数据存储器中的位的方法。 C50具有额外的移位和缩放功能，可以将被乘数正确对齐或将值存储到数据存储器。
C50通过IDLE2指令实现低功耗。 IDLE2从C50的内部硬件中删除功能时钟，使其进入仅使用7 uA的完全睡眠模式。持续时间至少为5个时钟周期的外部中断的低逻辑电平将终止IDLE2模式。
C50有两种时钟速度。时钟频率为50 MHz，周期时间为40 ns，周期为66 MHz，周期时间为30 ns。表1列出了可用选项。
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